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title: hi_isp_ae_stat_attr
description: "定义AE库返回给ISP的配置寄存器结构体。"
url: https://www.hiascend.com/document/detail/zh/canncommercial/latest/others/ispdevug/ispdevapi_0145.html
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# hi_isp_ae_stat_attr

#### 说明

定义AE库返回给ISP的配置寄存器结构体。


#### 定义

```
typedef struct {
hi_bool
change;
hi_bool
hist_adjust;
hi_u8
ae_be_sel;
hi_u8
four_plane_mode;
hi_u8
hist_offset_x;
hi_u8
hist_offset_y;
hi_u8
hist_skip_x;
hi_u8
hist_skip_y;
hi_bool
mode_update;
hi_u8
hist_mode;
hi_u8
aver_mode;
hi_u8
max_gain_mode;
hi_bool
wight_table_update;
hi_u8
weight_table[HI_VI_MAX_PIPE_NUM][HI_ISP_AE_ZONE_ROW][HI_ISP_AE_ZONE_COLUMN];
} hi_isp_ae_stat_attr;
```


#### 成员

| 子成员名称 | 描述 |
| --- | --- |
| change | 该结构体中的值是否需要配置寄存器。 HI\_FALSE：否； HI\_TRUE：是。 |
| hist\_adjust | 是否使能AE算法直方图调整。 HI\_FALSE：否； HI\_TRUE：是。 影响ae\_be\_sel/four\_plane\_mode/hist\_offset\_x/ hist\_offset\_y/hist\_skip\_x/hist\_skip\_y六个参数的配置。 hist\_adjust使能时，以上六个参数以hi\_isp\_ae\_result中的值为准配置芯片寄存器； hist\_adjust不使能时，以上六个参数以外部寄存器的值（MPI配置）为准配置芯片寄存器。 |
| ae\_be\_sel | BE中AE统计模块在ISP pipeline的位置，默认值为1。FE中AE统计模块固定在WB之后，位置不可移动。 0：After ISP digital gain 1：After static WB 2：After DRC |
| four\_plane\_mode | 是否使能FourPlaneMode，默认值为0，使能时1024段直方图为BGGR四通道256段直方图。 0：否； 1：是。 |
| hist\_skip\_x | 直方图统计时水平方向采样点设置，0=every pixel; 1=every 2nd pixel; 2=every 3rd pixel; 3=every 4th pixel; 4=every 5th pixel; 5=every 8th pixel; 6+=every 9th pixel。 即取值为0时表示每1个像素采样一个进行统计； 取值为1时表示每2个像素采样一个进行统计，以此类推。 0仅支持FourPlaneMode使能时配置。 |
| hist\_skip\_y | 直方图统计时垂直方向采样点设置，0=every pixel; 1=every 2nd pixel; 2=every 3rd pixel; 3=every 4th pixel; 4=every 5th pixel; 5=every 8th pixel; 6+=every 9th pixel。 |
| hist\_offset\_x | 直方图统计时水平方向起始点设置。 0表示从第一列开始统计； 1表示从第二列开始统计。 |
| hist\_offset\_y | 直方图统计时垂直方向起始点设置。 0表示从第一行开始统计； 1表示从第二行开始统计。 |
| mode\_update | AE算法开方模式配置使能，影响hist\_mode/ aver\_mode/ max\_gain\_mode三个参数的配置。 mode\_update不为0时，以上三个参数以hi\_isp\_ae\_result中的值为准配置逻辑寄存器； mode\_update为0时，以上三个参数以外部寄存器的值（MPI配置）为准配置逻辑寄存器。 |
| hist\_mode | 全局1024段直方图开方模式。 0为不开方； 1为开方。 仅影响BE直方图统计信息。 |
| aver\_mode | 均值开方模式。 0为不开方； 1为开方。 仅影响BE均值统计信息。 |
| max\_gain\_mode | MG模块开方模式。 0为不开方； 1为开方。 仅影响MG模块统计信息。为了与AE分块统计信息进行比较，建议与aver\_mode配置为同一模式。 |
| wight\_table\_update | AE算法权重表配置使能，影响weight\_table的配置。 wight\_table\_update不为0时，权重表以hi\_isp\_ae\_result中的值为准配置芯片寄存器； wight\_table\_update为0时，权重表以外部寄存器的值（MPI配置）为准配置芯片寄存器。 |
| weight\_table[HI\_ISP\_AE\_ZONE\_ROW][HI\_ISP\_AE\_ZONE\_COLUMN] | 15x17个区间的AE权重表，取值范围：[0, 15]。 \#define HI\_ISP\_AE\_ZONE\_ROW 15 \#define HI\_ISP\_AE\_ZONE\_COLUMN 17 |


#### 注意事项

- weight_table支持拼接模式下在主路配置多路权重，在主路对所有支路对应Pipe下标的权重表进行赋值即可。在非拼接模式下，只有对应Pipe下标的权重表生效。
- AE算法只支持1024段直方图，在使用AE算法情况下使能four_plane_mode会导致AE算法异常。